晶圓是什么東西半導體晶圓制造龍頭股

2026-04-27 知識百科經驗分享

晶圓是什么東西？晶圓是生產集成電路所用的載體。
晶圓（英語：Wafer)是指硅半導體集成電路制作所用的硅芯片，是生產集成電路（integrated circuit，IC）所用的載體。而我們現實中比較常見到的硅晶片就要數電腦CPU和手機芯片。
在半導體行業，尤其是集成電路領域，晶圓的身影隨處可見。晶圓就是一塊薄薄的、圓形的高純硅晶片，而在這種高純硅晶片上可以加工制作出各種電路元件構，使之成為有特定電性功能的IC產品。
晶圓制造工藝：
表面清洗：晶圓表面附著大約2um的Al2O3和甘油混合液保護層，在制作前必須進行化學刻蝕和表面清洗。
初次氧化：由熱氧化法生成SiO2緩沖層，用來減小后續中Si3N4對晶圓的應力氧化技術。
熱CVD：此方法生產性高，梯狀敷層性佳（不管多凹凸不平，深孔中的表面亦產生反應，及氣體可到達表面而附著薄膜）等，故用途極廣。
以上內容參考：百度百科-晶圓
晶圓是什么？

晶圓是微電子產業的行業術語之一。

高純度的硅（純度，99.99.....99，小數點后面9-11個9），一般被做成直徑6英寸，8英寸或者12英寸的圓柱形棒。

集成電路生產企業把這些硅棒用激光切割成極薄的硅片（圓形），然后在上面用光學和化學蝕刻的方法把電路、電子元器件做上去，做好之后的每片硅片上有大量的一片片的半導體芯片（小規模電路或者三極管的話，每片上可以有3000-5000片），這些加工好的圓形硅片就是晶圓。

之后它們將被送到半導體封裝工廠進行封裝，之后的成品就是我們看到的塑封集成電路或者三極管了。

晶圓是什么？
晶圓是指制作硅半導體電路所用的硅晶片。
晶圓原始材料是硅。高純度的多晶硅溶解后摻入硅晶體晶種，然后慢慢拉出，形成圓柱形的單晶硅。硅晶棒在經過研磨，拋光，切片后，形成硅晶圓片，也就是晶圓。如今國內晶圓生產線以8英寸和12英寸為主。
晶圓的主要加工方式為片加工和批加工，即同時加工1 片或多片晶圓。隨著半導體特征尺寸越來越小，加工及測量設備越來越先進，使得晶圓加工出現了新的數據特點。
晶圓的拋光：
為防止晶圓在旋轉過程中被甩出，拋光頭必須具有保持環結構。在 CMP 技術的發展歷程中出現過兩種保持環：固定保持環和浮動保持環。
由于固定保持環無法避免邊緣效應，目前的主流 CMP 裝備均采用了浮動保持環，通過對浮動保持環施加不殲彎同的壓力可以調節晶弊顫圓與拋光墊的接觸狀態，從而有效改善邊緣效應。
由于保持環與拋光墊緊密貼合，必須在保持環底部設計一系列溝槽以引導拋光液順利進入晶圓/拋光墊界面。此外，為提高壽命，保持環需選擇高強度、耐腐蝕、氏卜悶耐磨損的聚苯硫醚或聚醚酮等材料。

晶圓指的是什么東西？晶圓是指制作硅半導體積體電路所用的硅晶片，其原始材料是硅。
高純度的多晶硅溶解后摻入硅晶體晶種，然后慢慢拉出，形成圓柱形的單晶硅。硅晶棒在經過研磨，拋光，切片后，形成硅晶圓片，也就是晶圓。目前國內晶圓生產線以8英寸和12英寸為主。
在半導體行業，尤其是集成電路領域，晶圓的身影隨處可見。晶圓就是一塊薄薄的、圓形的高純硅晶片，而在這種高純硅晶片上可以加工制作出各種電路元件結構，使之成為有特定電性功能的IC產品。小伙伴或許在新聞中見過晶圓，通常他們是下圖的樣子。
【晶圓是什么東西半導體晶圓制造龍頭股】加工方式：
晶圓的主要加工方式為片加工和批加工，即同時加工一片或多片晶圓。隨著半導體特征尺寸越來越小，加工及測量設備越來越先進，使得晶圓加工出現了新的數據特點。
同時，特征尺寸的減小，使得晶圓加工時，空氣中的顆粒數對晶圓加工后質量及可靠性的影響增大，而隨著潔凈的提高，顆粒數也出現了新的數據特點。
晶圓簡介及詳細資料
基本簡介
晶圓的原始材料是矽，而地殼表面有用之不竭的二氧化矽。二氧化矽礦石經由電弧爐提煉，鹽酸氯化，并經蒸餾后，制成了高純度的多晶矽，其純度高達99.999999999% 。晶圓制造廠再把此多晶矽融解，再于融液里種入籽晶，然后將其慢慢拉出，以形成圓柱狀的單晶矽晶棒，由于矽晶棒是由一顆晶面取向確定的籽晶在熔融態的矽原料中逐漸生成，此過程稱為“長晶” 。矽晶棒再經過切段，滾磨，切片，倒角，拋光，雷射刻，包裝后，即成為積體電路工廠的基本原料——矽晶圓片，這就是“晶圓” 。
基本原料
矽是由石英沙所精練出來的，晶圓便是矽元素加以純化（99.999%），接著是將些純矽制成矽晶棒，成為制造積體電路的石英半導體的材料，經過照相制版，研磨，拋光，切片等程式，將多晶矽融解拉出單晶矽晶棒，然后切割成一片一片薄薄的晶圓。會聽到幾寸的晶圓廠，如果矽晶圓的直徑越大，代表著這座晶圓廠有較好的技術。另外還有scaling技術可以將電晶體與導線的尺寸縮小，這兩種方式都可以在一片晶圓上，制作出更多的矽晶粒，提高品質與降低成本。所以這代表6寸、8寸、12寸晶圓當中，12寸晶圓有較高的產能。當然，生產晶圓的過程當中，良品率是很重要的條件。
制造過程
晶圓制造廠再把許多晶矽融解，再于融液里種入籽晶，然后將其慢慢拉出舉信，以形成圓柱狀的單晶矽晶棒，由于矽晶棒是由一顆晶面取向確定的籽晶在熔融態的矽原料中逐漸生成，此過程稱為“長晶” 。矽晶棒再經過切段，滾磨，切片，倒角，拋光，雷射刻，包裝后，即成為積體臘漏電路工廠的基本原料——矽晶圓片，這就是“晶圓” 。
制造工藝
表面清洗
晶圓表面附著一層大約2um的Al2O3和甘油混合液保護之,在制作前必須進行化學刻蝕和表面清洗。
初次氧化
有熱氧化法生成SiO2 緩沖層，用來減小后續中Si3N4對晶圓的應力氧化技術：干法氧化Si(固)+O2 à SiO2(固)和濕法氧化Si(固)+2H2O à SiO2(固)+2H2 。干法氧化通常用來形成，柵極二氧化矽膜，要求薄，界面能級和固定電荷密度低的薄膜。干法氧化成膜速度慢于濕法。濕法氧化通常用來形成作為器件隔離用的比較厚的二氧化矽膜。當SiO2膜較薄時，膜厚與時間成正比。SiO2膜變厚時，膜厚與時間的平方根成正比。因而，要形成較厚SiO2膜，需要較長的氧化時間。SiO2膜形成的速度取決于經擴散穿過SiO2膜到達矽表面的O2及OH基等氧化劑的數量的多少。濕法氧化時，因在于OH基SiO2膜中的擴散系數比O2的大。氧化反應，Si 表面向深層移動，距離為SiO2膜厚的0.44倍。因此，不同厚度的SiO2膜，去除后的Si表面的深度也不同。SiO2膜為透明，通過光干涉來估計膜的厚度。這種干涉色的周期約為200nm，如果預告知道是幾次干涉，就能正確估計。對其他的透明薄膜，如知道其折射率，也可用公式計算出(dSiO2)/(dox)=(nox)/(nSiO2) 。SiO2膜很薄時，看不到干涉色，但可利用Si的疏水性和SiO2的親水性來判斷SiO2膜是否存在。也可用干涉膜計或橢圓儀等測出。SiO2和Si界面能級密度和固定電荷密度可由MOS二極體的電容特性求得。(100)面的Si的界面能級密度最低，約為10E+10-- 10E+11/cm ?2.eV-1 數量級。(100)面時，氧化膜中固定電荷較多，固定電荷密度的大小成為左右閾值的主要因素。
熱CVD
熱CVD(HotCVD)/(thermalCVD)
此方法生產性高，梯狀敷層性佳(不管多凹凸不平，深孔中的表面亦產生反應，及氣體可到達表面而附著薄膜)等，故用途極廣。膜生成原理，例如由揮發性金屬鹵化物(MX)及金屬有機化合物(MR)等在高溫中氣相化學反應(熱分解，氫還原、氧化、替換反應等)在基板上形成氮化物、氧化物、碳化物、矽化物、硼化物、高熔點金屬、金屬、半導體等薄膜方輪答爛法。因只在高溫下反應故用途被限制，但由于其可用領域中，則可得致密高純度物質膜，且附著強度極強，若用心控制，則可得安定薄膜即可輕易制得觸須(短纖維)等，故其套用范圍極廣。熱CVD法也可分成常壓和低壓。低壓CVD適用于同時進行多片基片的處理，壓力一般控制在0.25-2.0Torr之間。作為柵電極的多晶矽通常利用HCVD法將SiH4或Si2H 。氣體熱分解（約650oC）淀積而成。采用選擇氧化進行器件隔離時所使用的氮化矽薄膜也是用低壓CVD法，利用氨和SiH4 或Si2H6反應面生成的，作為層間絕緣的SiO2薄膜是用SiH4和O2在400--4500oC的溫度下形成SiH4+O2-SiO2+2H2或是用Si(OC2H5)4(TEOS:tetra ethoxy silanc)和O2在750oC左右的高溫下反應生成的，后者即采用TEOS形成的SiO2膜具有臺階側面部被覆性能好的優點。前者，在淀積的同時導入PH3 氣體，就形成磷矽玻璃（ PSG： phosphor silicate glass）再導入B2H6氣體就形成BPSG(borro ? phosphor silicate glass)膜。這兩種薄膜材料，高溫下的流動性好，廣泛用來作為表面平坦性好的層間絕緣膜。
熱處理
在涂敷光刻膠之前，將洗凈的基片表面涂上附著性增強劑或將基片放在惰性氣體中進行熱處理。這樣處理是為了增加光刻膠與基片間的粘附能力，防止顯影時光刻膠圖形的脫落以及防止濕法腐蝕時產生側面腐蝕(sideetching) 。光刻膠的涂敷是用轉速和鏇轉時間可自由設定的甩膠機來進行的。首先、用真空吸引法將基片吸在甩膠機的吸盤上，把具有一定粘度的光刻膠滴在基片的表面，然后以設定的轉速和時間甩膠。由于離心力的作用，光刻膠在基片表面均勻地展開，多余的光刻膠被甩掉，獲得一定厚度的光刻膠膜，光刻膠的膜厚是由光刻膠的粘度和甩膠的轉速來控制。所謂光刻膠，是對光、電子束或X線等敏感，具有在顯影液中溶解性的性質，同時具有耐腐蝕性的材料。一般說來，正型膠的分辯率高，而負型膠具有感光度以及和下層的粘接性能好等特點。光刻工藝精細圖形(分辯率，清晰度)，以及與其他層的圖形有多高的位置吻合精度(套刻精度)來決定，因此有良好的光刻膠，還要有好的曝光系統。
除氮化矽
此處用干法氧化法將氮化矽去除
離子注入
離子布植將硼離子 (B+3) 透過 SiO2 膜注入襯底，形成P型阱離子注入法是利用電場加速雜質離子，將其注入矽襯底中的方法。離子注入法的特點是可以精密地控制擴散法難以得到的低濃度雜質分布。MOS電路制造中，器件隔離工序中防止寄生溝道用的溝道截斷，調整閥值電壓用的溝道摻雜，CMOS的阱形成及源漏區的形成，要采用離子注入法來摻雜。離子注入法通常是將欲摻入半導體中的雜質在離子源中離子化，然后將通過質量分析磁極后選定了離子進行加速，注入基片中。退火處理
去除光刻膠放高溫爐中進行退火處理以消除晶圓中晶格缺陷和內應力，以恢復晶格的完整性。使植入的摻雜原子擴散到替代位置，產生電特性。去除氮化矽層
用熱磷酸去除氮化矽層，摻雜磷 (P+5) 離子，形成 N 型阱，并使原先的SiO2 膜厚度增加，達到阻止下一步中n 型雜質注入P 型阱中。
去除SIO2層
退火處理，然后用 HF 去除 SiO2 層。干法氧化法
干法氧化法生成一層SiO2 層，然后LPCVD 沉積一層氮化矽。此時P 阱的表面因SiO2 層的生長與刻蝕已低于N 阱的表面水平面。這里的SiO2 層和氮化矽的作用與前面一樣。接下來的步驟是為了隔離區和柵極與晶面之間的隔離層。光刻技術和離子刻蝕技術
利用光刻技術和離子刻蝕技術，保留下柵隔離層上面的氮化矽層。濕法氧化
生長未有氮化矽保護的 SiO2 層，形成 PN 之間的隔離區。生成SIO2薄膜
熱磷酸去除氮化矽，然后用 HF 溶液去除柵隔離層位置的 SiO2 ，并重新生成品質更好的 SiO2 薄膜 , 作為柵極氧化層。氧化
LPCVD 沉積多晶矽層，然后涂敷光阻進行光刻，以及等離子蝕刻技術，柵極結構，并氧化生成 SiO2 保護層。形成源漏極
表面涂敷光阻，去除 P 阱區的光阻，注入砷 (As) 離子，形成 NMOS 的源漏極。用同樣的方法，在 N 阱區，注入 B 離子形成 PMOS 的源漏極。沉積
利用 PECVD 沉積一層無摻雜氧化層，保護元件，并進行退火處理。沉積摻雜硼磷的氧化層
含有硼磷雜質的SiO2 層，有較低的熔點，硼磷氧化層(BPSG) 加熱到800 oC 時會軟化并有流動特性，可使晶圓表面初級平坦化。深處理
濺鍍第一層金屬利用光刻技術留出金屬接觸洞，濺鍍鈦+ 氮化鈦+ 鋁+ 氮化鈦等多層金屬膜。離子刻蝕出布線結構，并用PECVD 在上面沉積一層SiO2 介電質。并用SOG (spin on glass) 使表面平坦，加熱去除SOG 中的溶劑。然后再沉積一層介電質，為沉積第二層金屬作準備。
（1）薄膜的沉積方法根據其用途的不同而不同，厚度通常小于 1um。有絕緣膜、半導體薄膜、金屬薄膜等各種各樣的薄膜。薄膜的沉積法主要有利用化學反應的CVD(chemical vapor deposition) 法以及物理現象的PVD(physical vapor deposition) 法兩大類。CVD 法有外延生長法、HCVD ，PECVD 等。PVD 有濺射法和真空蒸發法。一般而言，PVD 溫度低，沒有毒氣問題； CVD 溫度高，需達到1000 oC 以上將氣體解離，來產生化學作用。PVD 沉積到材料表面的附著力較CVD 差一些，PVD 適用于在光電產業，而半導體制程中的金屬導電膜大多使用PVD 來沉積，而其他絕緣膜則大多數采用要求較嚴謹的CVD 技術。以PVD 被覆硬質薄膜具有高強度，耐腐蝕等特點。
（2）真空蒸發法（ Evaporation Deposition ）采用電阻加熱或感應加熱或者電子束等加熱法將原料蒸發淀積到基片上的一種常用的成膜方法。蒸發原料的分子（或原子）的平均自由程長（ 10 -4 Pa 以下，達幾十米），所以在真空中幾乎不與其他分子碰撞可直接到達基片。到達基片的原料分子不具有表面移動的能量，立即凝結在基片的表面，所以，在具有臺階的表面上以真空蒸發法淀積薄膜時，一般，表面被覆性（覆蓋程度）是不理想的。但若可將Crambo真空抽至超高真空（ <10 – 8 torr ），并且控制電流，使得欲鍍物以一顆一顆原子蒸鍍上去即成所謂分子束磊晶生長（ MBE ： Molecular Beam Epitaxy ）。
（3）濺鍍（ Sputtering Deposition ）所謂濺射是用高速粒子（如氬離子等）撞擊固體表面，將固體表面的原子撞擊出來，利用這一現象來形成薄膜的技術即讓電漿中的離子加速，撞擊原料靶材，將撞擊出的靶材原子淀積到對面的基片表面形成薄膜。濺射法與真空蒸發法相比有以下的特點：臺階部分的被覆性好，可形成大面積的均質薄膜，形成的薄膜，可獲得和化合物靶材同一成分的薄膜，可獲得絕緣薄膜和高熔點材料的薄膜，形成的薄膜和下層材料具有良好的密接性能。因而，電極和布線用的鋁合金（ Al-Si, Al-Si-Cu ）等都是利用濺射法形成的。最常用的濺射法在平行平板電極間接上高頻（ 13.56MHz ）電源，使氬氣（壓力為1Pa ）離子化，在靶材濺射出來的原子淀積到放到另一側電極上的基片上。為提高成膜速度，通常利用磁場來增加離子的密度，這種裝置稱為磁控濺射裝置（ magron sputter apparatus ），以高電壓將通入惰性氬體游離，再借由陰極電場加速吸引帶正電的離子，撞擊在陰極處的靶材，將欲鍍物打出后沉積在基板上。一般均加磁場方式增加電子的游離路徑，可增加氣體的解離率，若靶材為金屬，則使用DC 電場即可，若為非金屬則因靶材表面累積正電荷，導致往后的正離子與之相斥而無法繼續吸引正離子，所以改為RF 電場（因場的振蕩頻率變化太快，使正離子跟不上變化，而讓RF-in 的地方呈現陰極效應）即可解決問題。光刻技術定出 VIA 孔洞
沉積第二層金屬，并刻蝕出連線結構。然后，用 PECVD 法氧化層和氮化矽保護層。光刻和離子刻蝕
定出 PAD 位置。最后進行退火處理
以保證整個 Chip 的完整和連線的連線性。
相關儀器
8寸晶圓顯微鏡檢測系統通過機械手將晶圓從片盒取出放在真空吸附托盤上，通過滑鼠或操作按鍵改變晶圓的轉向以初步檢查。顯微鏡平臺可進行精密檢測，能夠觀察晶圓微觀的顆粒，劃傷，污染等情況。這種機械手采用了直線型真空吸附結構，靈活可靠，顯微鏡平臺能夠提供40-1000倍的觀察效果。它還可以提供多種靈活多變的晶圓檢測模式，包含以下檢測內容：晶圓ID、晶圓notch的方向、晶圓鏇轉角度及速度、晶圓微觀的晶格等，并能夠實現連續監控。
企業前沿
臺積電Q4晶圓產能增加
對于計算機產品而言，晶片可以說是其精髓所在，畢竟晶片的等級也就決定了產品的性能表現以及功耗、發熱量等額外因素，作為晶片的前身，晶圓的品質和制程就成為消費者以及廠商所共同關心的，2009年9月，臺積電傳出訊息，將會在此后幾個月里對40/45nm（40/45納米）制程的300mm晶圓產品進行增產。
在此之前的預測中，業內普遍分析認為第四季度的晶片銷量將會有3%左右的下降，但是臺積電對40/45nm制程300mm晶圓產品的增產決定依然沒有受到影響，在2009年的剩余時間里，臺積電的40/45nm制程300mm晶圓產品平均月產量將可能達到40000片，提升幅度達到了三分之一。Intel、三星、臺積電2012年投產450mm晶圓
2008年5月6 日，Intel宣布與三星、臺積電達成合作協定，在2012年投產450mm晶片晶圓，預計會首先用于切割22nm工藝處理器，而這種處理器會在2011年底發布——當然首批還是采用300mm晶圓。
晶圓尺寸的更新換代一般都需要十年左右，比如200mm晶圓是1991年誕生的，截至2008年，廣泛使用的300mm晶圓則是Intel在2001年引入的，并首先用于130nm工藝處理器。事實上，仍有些半導體企業仍未完成從200mm向300mm的過渡，而Intel此番準備升級450mm必然會讓半導體產業的晶片制造經濟得到進一步發展。
450mm晶圓無論是矽片面積還是切割晶片數都是300mm的兩倍多，因此每顆晶片的單位成本都會大大降低。另外，大尺寸晶圓還會提高能源、水等資源的利用效率，減少對環境污染、溫室效應全球變暖、水資源短缺的影響。
當然，投資更大尺寸的晶圓是需要巨額投資的，一般來說年收入低于100億美元的企業都無力承擔。Intel雖然不存在這方面的困擾，但也沒有單干，而是采取了和其他業界廠商合作的做法，以“幫忙降低風險和轉換成本” 。
Intel、三星和臺積電計畫“與整個半導體產業合作，確保所有必需的部件、基礎設施、生產能力都能在2012年完成開發和測試，并投入試驗性生產” 。
在北京的2009年春季IDF上，Intel再次談到了代號Larrabee的獨立顯示卡產品，而且由高級副總裁兼數字企業事業部總經理帕特·基辛格(Pat Gelsinger)第一次公開展示了相關晶圓。雖然看不清晶圓細節，但依稀可以辨別Larrabee核心相當巨大，頗有些65nm GT200的架勢，估計能達到600平方毫米左右(65nm GT200是576平方毫米) 。不過很遺憾，基辛格只是給了大家驚鴻一瞥的機會，并說Larrabee將于2009年底或2010年初發布，沒有提及實際生產工藝和規格參數。至于有關Larrabee的技術細節，諸如編程模式之類的，相信除非專業研究不會感興趣的。非洲的晶圓級封裝
沒錯，就是在非洲。NemotekTechnologie正在其位于摩洛哥拉巴特科技園（Moroo’sRabatTechnopolisPark）的先進的工廠設施里，制造晶圓級光學器件和封裝。
就在這家初創公司（Nemotek）的資金狀況捉襟見肘的時候，他們獲得了來自摩洛哥的一家投資公司CaissedeDépôtetdeGestion(CDG)的大力支持，迄今投資額達4000萬美元之多。他們的目標是什么呢？在摩洛哥建立一個高科技制造的市場新領域。Nemotek去年創立，專注于設計和制造客制化的晶圓級攝像頭，套用于諸如手機、PC、安防攝像頭和其他手持設備中。當你想到晶圓級光學器件和封裝制造時，第一反應不太可能是非洲。但是位于摩洛哥首都拉巴特（Rabat）的NemotekTechnologie正在努力改變這個事實。
最近，Nemotek公司10,000m2先進的制造和封裝工廠設施的第一部分已經獲得資格認證，并計畫于今年晚些時候開始發貨晶圓級鏡頭和攝像頭。初始產能將為每年發貨大約17,000片晶圓，但是Nemotek期望到2012年每年的產能能躍升至150,000片晶圓。據Nemotek公司的CEOJackyPerdrigeat介紹，Nemotek正從Tessera(SanJose)公司獲得兩項晶圓級技術的許可，覆蓋晶圓級攝像頭的封裝和光學部分。.
摩爾定律
一、摩爾定律的起源
在計算機領域有一個人所共知的“摩爾定律”，它是英特爾公司創始人之一戈登·摩爾(Gordon Moore)于1965年在總結存儲器晶片的增長規律時(據說當時在準備一個講演)所使用的一份手稿。
“摩爾定律”通常是引用那些訊息靈通人士的話來說就是：“在每一平方英寸矽晶圓上的電晶體數量每個12月番一番 ?！毕旅媸悄栐?965年的報紙上所引用的圖：
圖中顯示出電晶體密度每個12月增加一倍，然而，在摩爾的簡短論著中并沒有對這方面進行完整的論述。摩爾發表那篇論文的本意是為了探討如何合理縮減積體電路電晶體體尺寸、降低制造成本的方法。更重要的是，他知道這種尺寸上的縮小將帶來重要的意義：未來的積體電路將會更便宜、功能更多，可集成電晶體數量越多，從而使電子產品日趨廉價化、普及化，并終將對人類的生活、工作產生巨大影響。
在摩爾定律中提到減少成本是積體電路最大的吸引力之一，并且隨著技術發展，集成化程度越高，低成本的優點更為明顯。對于簡單的電路來說，每個部件的費用與電路中所含電晶體的數量成反比關系。但同時，隨著集成度的提高，電路復雜性也隨之提高，由此帶來的制造成本也將提高。當然，應該注意到摩爾的原作僅僅只有4頁紙的篇幅，而現在的文章篇幅卻長多了。這是因為我們所說的“摩爾定律”這一個名稱其實并不是十分嚴謹，因為它其實并非科學或自然界的一個定律，而至多也僅僅是一個規律，用來描述由于不斷改進的半導體生產工藝所帶來的一個指數級增長的獨特發展規律。
那么摩爾所提到的“最小元件成本的復雜性”究竟指什么呢？制造缺陷、制造成本與集成度之間又存在什么樣的關系？讓我們按照作者的本意來改寫一下我們所熟知的“電晶體倍增定律”：使換算后每個電晶體制造成本達到最低的積體電路晶片所含的電晶體個數每年將倍增。
經過這樣改寫的摩爾定律，或許就更加地貼近摩爾先生的本意了。但是僅憑這樣的一句話，仍然很難準確地表達增加集成度所帶來的每元件成本下降與積體電路制造成本間的互動關系，因此，在下面，我們將詳細地舉例說明，以便大家更透徹地了解摩爾定律的本質。
二、摩爾定律與矽晶片的經濟生產規模
大多數讀者都已經知道每個晶片都是從矽晶圓中切割得來，因此將從晶片的生產過程開始討論。下面，是一幅集成晶片的矽晶圓圖像。(右邊的矽晶圓是采用0.13微米制程P4所用的矽晶圓。)
通過使用化學、電路光刻制版技術，將電晶體蝕刻到矽晶圓之上，一旦蝕刻是完成，單個的晶片被一塊塊地從晶圓上切割下來。
在矽晶圓圖示中，用黃點標出的地方是表示這個地方存在一定缺陷，或是在矽晶圓被蝕刻入的電晶體起不了任何作用，這一切是由于制造技術限制而造成的，任何一個存在上面問題的晶片將因不能正常工作而被報廢。上圖中，一塊矽晶圓中蝕刻了16個電晶體，但其中4個電晶體存在缺陷，因此我們就不得不把16個晶片中的4個報廢掉(即占這塊矽晶圓的1/4 ) 。如果這塊矽晶圓代表我們生產過程中生產的所有矽晶圓，這意味著我們廢品率就是1/4，這種情況將導致制造成本的上升。
在無法對現在的制造進程進行實質性改進的情況下，我們有兩個方法來降低電晶體報廢率從而增加當前75%的良品率。其一就是改進我們的生產制程、最佳化加工過程，降低每塊矽晶圓上的晶圓壞點密度。不過在我們討論如何減少壞點密度之前，我認為應該花一點時間來讓大家了解一下半導體的2個基本生產參數—矽晶圓尺寸和蝕刻尺寸。
當一個半導體制造者建造一個新晶片生產工廠時，你將通?？吹剿显谑褂孟嚓P資料上使用這2個數字：矽晶圓尺寸和特性尺寸。矽晶圓尺寸是在半導體生產過程中矽晶圓使用的直徑值 ?？偟膩碚f，一套特定的矽晶圓生產設備所能生產的矽晶圓尺寸是固定，因為對原設備進行改造來生產新尺寸的矽晶圓而花費資金是相當驚人的，這些費用幾乎可以建造一個新的生產工廠。這樣我們就無法隨心所欲地增大晶圓尺寸。
你可能這樣想像，矽晶圓尺寸越大越好，這樣每塊晶圓能生產更多的晶片。然而，矽晶圓有一個特性來限制制造商隨意增加矽晶圓的尺寸，那就是在晶圓生產過程中，離晶圓中心越遠就越容易出現壞點。因此從矽晶圓中心向外擴展，壞點數是呈上升趨勢。半導體生產商們也總是致力于在盡量大的晶圓上控制壞點的數量，比如8086 CPU制造時最初所使用的晶圓尺寸是50mm，而現在英特爾已經開始使用300mm尺寸矽晶圓生產工廠生產新一代處理器。
至于蝕刻尺寸是制造設備在一個矽晶圓上所能蝕刻的一個最小尺寸。因此當你聽見P4采用0.13微米制程時，這
8086有3u蝕刻尺寸，Pentium的蝕刻尺寸是0.8u，并且Pentium 4的蝕刻尺寸當前是0.13u，而目前英特爾的正在建造的矽晶圓廠能蝕刻0.09u的蝕刻尺寸。象矽晶圓尺寸一樣，蝕刻尺寸也是被固定的，所有的矽晶圓制造廠都是按某幾個特定的蝕刻尺寸來生產晶片。雖然在這篇文章中我們將進行關于蝕刻尺寸更多的談論，但我們現在要指出的是—它是一個被固定的參數，也是不經常變化。下面我們將通過一個簡單的例子，對矽晶圓尺寸和蝕意味意指Pentium 4的電晶體尺寸最小可以做成0.13微米那么大，就是說這個加工廠在晶
圓上所能蝕刻的最小電晶體尺寸是0.13微米。你將通?？匆姟拔g刻尺寸”和“電晶體尺寸”這兩個術語是可以交換使用的，因為在一志積體電路上的最重要的特性就是電晶體。
專業術語
1.Wafer Probe 晶圓針測工序2.waferballing process 晶圓球狀化工藝3.bonded wafer已粘接晶圓4.cassette, wafer 晶圓匣5.tray, wafer 晶圓承載器6.wafer tray 晶圓承載器7.wafer cassette 晶圓匣8.wafer aeptance (WAT) 晶圓驗收測試9.wafer 晶圓10.Wafer Mapping 晶圓映射11.Wafer burn-in 晶圓老化12.Multi Project Wafer多項目晶圓

半導體中名詞“wafer”“chip”“die”的聯系和區別是什么？
一、半導體中名詞“wafer”“chip”“die”中文名字和用途
①wafer——晶圓
wafer 即為圖片所示的晶圓，由純硅（Si）構成。一般分為6英寸、8英寸、12英寸規格不等，晶片就是基于這個wafer上生產出來的。晶圓是指硅半導體集成電路制作所用的硅晶片，由于其形狀為圓形，故稱為晶圓；在硅晶片上可加工制作成各種電路元件結構，而成為有特定電性功能的集成電路產品。
②chip——芯片
一片載有Nand Flash晶圓的wafer，wafer首先經過切割，然后測試，將完好的、穩定的、足容量的die取下，封裝形成日常所見的Nand Flash芯片（chip）。芯片一般主要含義是作為一種載體使用，并且集成電路經過很多道復雜的設計工序之后所產生的一種結果。
③die——晶粒
Wafer上的一個小塊，就是一個晶片晶圓體，學名die，封裝后就成為一個顆粒。晶粒是組成多晶體的外形不規則的小晶體，而每個晶粒有時又有若干個位向稍有差異的亞晶粒所組成。晶粒的平均直徑通常在0.015~0.25mm范圍內，而亞晶粒的平均直徑通常為0.001mm數量級。
二、半導體中名詞“wafer”“chip”“die”的聯系和區別
①材料來源方面的區別
以硅工藝為例，一般把整片的硅片叫做wafer，通過工藝流程后每一個單元會被劃片，封裝。在封裝前的單個單元的裸片叫做die 。chip是對芯片的泛稱，有時特指封裝好的芯片。
②品質方面的區別
品質合格的die切割下去后，原來的晶圓就成了下圖的樣子，就是挑剩下的Downgrade Flash Wafer 。這些殘余的die，其實是品質不合格的晶圓。被摳走的部分，也就是黑色的部分，是合格的die，會被原廠封裝制作為成品NAND顆粒，而不合格的部分，也就是圖中留下的部分則當做廢品處理掉。
③大小方面的區別
封裝前的單個單元的裸片叫做die 。chip是對芯片的泛稱，有時特指封裝好的芯片。cell也是單元，但是比die更加小 cell <die< chip 。

擴展資料
一汪輪升、半導體基本介紹
半導體指常溫下導電性能介于導體與絕緣體之間的材料。半導體在消費電子、通信系統、醫療儀器等領域有廣泛應用。如二極管就是采用半導體制作的器件。無論從科技或是經濟發展的角度來看，半導體的重要性都是非常巨大的。
今日大部分的電子產品，如計算機、移動電話或是數字錄音機當中的核心單元都和半導體有著極為密切的關連。常見的半導體材料有困老硅、鍺、砷化鎵等，而硅更是各種半導體材料中，在商業應用上最具有影響力的一種。
半導體芯片的制造過程可以分為沙子原料桐空（石英）、硅錠、晶圓、光刻，蝕刻、離子注入、金屬沉積、金屬層、互連、晶圓測試與切割、核心封裝、等級測試、包裝等諸多步驟，而且每一步里邊又包含更多細致的過程。

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